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嵌入式協處理器--DSP

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FPGA項目實戰系列課程----

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Linux實戰就業班

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公益培訓

第6期曙海大型嵌入式公益培訓
“嵌入式DSP宣講會”

第5期曙海大型嵌入式公益培訓
“嵌入式FPGA宣講會”

第4期曙海大型嵌入式公益培訓
“嵌入式DSP6000宣講會”

第3期曙海大型嵌入式公益培訓
“嵌入式Linux宣講會”

第2期曙海大型嵌入式公益培訓
“嵌入式Wince宣講會”

第1期曙海大型嵌入式公益培訓
“嵌入式Linux宣講會”

曙海動態

2009年“寒假培訓系列課程”
開始招生[2008-12-31]

曙海嵌入式隆重推出“寒
假培訓系列課程”[2007-12-16]

慶祝曙海創立5周年，部分課
程9折回饋學員[2006-03-12]

為普及嵌入式課程，學生
報名享受優惠[2005-08-03]

曙海教育嵌入式培訓課程全面
升級,啟用2.0版[2004-06-14]

曙海教育成為Altera公司
全球合作培訓機構[2002-10-07]

020321屆Linux驅動開發班
學生圓滿畢業[2002-04-25]

上海計算機技術協會頒發給曙海
高新技術科技證書[2001-05-19]

FPGA項目實戰系列課程－－軟件無線電應用方向

課程目標

　　通過本期培訓使學員不但能夠精通基于FPGA的信號處理算法，而且能夠掌握軟件無線電的核心算法，利用FPGA開發設計高速數字化無線通信接收機和發射機，另外通過本期培訓也可以開發設計手機、雷達、無線網絡設備、無線遙感器、無線識別器、無線導航儀、無線光電設備等。

入學要求

理工科類大專以上學歷;喜歡并有志投身于IT事業;具備一定硬件知識;了解Verilog HDL硬件描述語言。

班級規模及環境

為了保證培訓效果，增加互動環節，我們堅持小班授課，每期報名人數限5人，多余人員安排到下一期進行。

時間地點

上課地點：【【上海】：同濟大學(滬西)/新城金郡(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區1號（中和大道）
近開課時間(周末班/連續班/晚班）：無線電應用開班時間：2025年5月19日....--即將開課--............

學時

　    ◆課時：共5天，30學時
        ◆外地學員：代理安排食宿（需提前預定）
        ☆合格學員免費頒發相關資格證書，提升您的職業資質
        作為早專注于嵌入式培訓的專業機構，曙海嵌入式提供的證書得到本行業的廣泛認
        可，學員的能力得到大家的認同。
        ☆合格學員免費推薦工作
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新優惠

◆團體報名優惠措施：兩人95折優惠，三人或三人以上9折優惠。注意：在讀學生憑學生證，即使一個人也優惠500元。

質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后免費提供一個月的技術支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業機會。

課程大綱

第一篇軟件無線電系統概述及仿真

1. 軟件無線電系統概述
2. 軟件無線電的三種結構形式
3. 設計方法和技巧
4. 仿真設計

第二篇基于FPGA/CPLD的數字濾波器工程應用與工程課題實訓

1. CIC濾波器算法原理
2. DSP介紹
3. 基于FPGA/CPLD的CIC濾波器工程應用以及工程課題實訓
4. 基于FPGA/CPLD的高斯白噪聲信號工程應用以及工程課題實訓

第三篇基于FPGA/CPLD的數字上下變頻工程應用與工程課題實訓

1. 基于FPGA/CPLD的載波NCO產生原理與工程應用
2. 基于FPGA/CPLD的數字上變頻原理與工程應用
3. 基于FPGA/CPLD的數字下變頻原理與工程應用
4. 基于FPGA/CPLD的數字上下變頻工程課題實訓

第四篇基于FPGA/CPLD的數字調制解調工程應用與工程課題實訓

1. 數字調制解調的基本原理、設計方法以及影響選擇數字調制方式的因素
2. 基于FPGA/CPLD的調制解調工程應用
3. 基于FPGA/CPLD的調制解調工程實驗

第七篇項目實訓項目名稱：基于BPSK調制解調的高速數字化無線通信系統核心技術：碼NCO、成形濾波器、載波NCO、高斯白噪聲、數字下變頻、BPSK調制解調、CIC濾波器、載波環跟蹤(科斯塔斯Costas環)、數字上變頻、高斯濾波、抽取、插值、低通濾波。（注：這些核心技術全部是通過軟件編程的方式實現）

項目主要內容：
該通信系統有兩部分組成，一部分為高速數字化無線通信發射機，一部分為高速數字化無線通信接收機。在基于FPGA設計的高速數字化無線通信發射機中，信源碼經過低通濾波等變換后進行BPSK調制，然后再通過數字上變頻將基帶信號混頻到中頻信號，再經過濾波后送D/A轉換器輸出射頻信號。以上這些工作全部是在FPGA內通過Verilog編程實現。