FPGA培訓(xùn)

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FPGA培訓(xùn)實(shí)驗(yàn)要點(diǎn)--FPGA語(yǔ)法知識(shí)

語(yǔ)法知識(shí)：

3。1 簡(jiǎn)介
3.2.1 程序入門(mén)

module 名稱(chēng) （輸入/輸出端口）；

input [2:0] a,b;

endmodule

== 完全匹配，比較
equal=（a>b)?1:0

= 阻塞賦值

多個(gè)module之間怎樣協(xié)同工作：
a.先指定一個(gè)頂層module
b.其他module通過(guò)實(shí)例化供頂層module調(diào)用

書(shū)寫(xiě)注意：
a.除了endmodule沒(méi)有";"外，其余的都必須有
c.注釋有兩種：/* */ ,//

常量：
a.進(jìn)制：是不區(qū)分大小寫(xiě)
b.注意第三種情況：如果只有一個(gè)數(shù)字，說(shuō)明采用十進(jìn)制，寬度由具體的機(jī)器系數(shù)決定
至少32位
c.?=z

(3)負(fù)數(shù)："-"在位寬的前面
（4）下劃線(xiàn)
a.常量默認(rèn)32位
b.每個(gè)字母用8位的ASCII
2.參數(shù)
'A'
"A\n"

define lingting =EE

注意：module中如沒(méi)有輸入輸出可以不聲明

3.3.1.2 變量

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